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在用SystemVerilog码代码的时候，经常会遇到逻辑和算术运算表达式，除了之前提到的运算符优先级问题，还有一个头疼的问题就是符号位扩展。
什么时候会自动进行符号位扩展？
什么时候需要人工扩展？
不知道大家是否了然于胸呢？
先来想想下面这几个问题，热热身：
对有符号数进行截位，会得到有符号数吗？
有符号数和无符号数相加，结果是有符号数吗？
操作数都是有符号数，结果一定是有符号数吗？
别担心，今天Q哥跟大家一起梳理一遍。
先说两个概念，context-determined操作数和self-d
